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Synopsys Design Compiler

Synopsys Design Compiler

ASIC-Logiksynthesesoftware zum Kompilieren von Verilog, VHDL und System Verilog in eine GDSII-Maske für die IC-Herstellung.
Synopsys bietet Design Compiler 2010 an, mit dem sich der Synthesevorgang und der Ablauf der physischen Implementierung verdoppeln lassen.RTL-Designer können die Grundrisserkundung durchführen, um Grundrissprobleme frühzeitig zu erkennen und zu beheben.

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Alternativen zu Synopsys Design Compiler für alle Plattformen mit kostenloser Lizenz

Synplify Pro

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Generisches FPGA-Synthese-Frontend für FPGAs wie Xilinx und Altera.